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信号の立ち上がりや立ち下がりの記述方法です HD219C 三越環境デザイン Brugge キャスター付アームチェア 【クーポン配布中】 (ブルージュ) コロナ 05P05Nov16 【RCP】 【代引不可】 前板鏡面タイプ (テレビ台/テレビボード) エントリーで10倍_背面収納コーナーTVボード ブラック _送料無料 (黒) 【26型~37型対応】 幅110cm 『ROBIN』 「飛騨」 ジャパニーズデザイン1人掛けソファー 【dx】。回路の動作開始タイミングを決めたり、信号変化の回数を数えるカウンタを作ったり。様々な場面で必要になります 。

エッジ検出記述方法

library ieee;
use ieee.std_logic_1164.all;
use ieee.std_logic_unsigned.all;
entity edge_detect is
 port (
 srstn_i : in std_logic;
 clk_i : in std_logic;
 sig_i : in std_logic;
 rise_o : out std_logic;
 fall_o : out std_logic
 );
end edge_detect;
architecture rtl of edge_detect is
signal sig_ff : std_logic;
begin
process (clk_i) begin
 if (rising_edge(clk_i)) then
 if (srstn_i = '0') then
 sig_ff <= '0';
 else
 sig_ff <= sig_i;
 end if;
 end if;
end process;
-- 組み合わせ回路での書き方
rise_o <= sig_i and (not sig_ff);
fall_o <= (not sig_i) and sig_ff;
---- when文での書き方
--rise_o <= '1' when ((sig_i = '1') and (sig_ff = '0')) else '0';
--fall_o <= '1' when ((sig_i = '0') and (sig_ff = '1')) else '0';
end rtl;

自分は初めは見た目に分かりやすいwhen文の方を使用していたのですが、現在は記述量の短い組み合わせ回路の記述方法を使用しています。少し考えれば同じことですしね。

シミュレーション波形

組み合わせ回路の方は波形を見るとわかりやすいです。具体的にみると、"sig_i and (not sig_ff)"を満たすときだけ、"rise_o"がアサートされます 麻混の寝具カバー3点セット 布団カバーセット ブラック (掛けカバー+ベッドシーツ+枕カバー) ベッド用シングル 【布団カバー】 シングルサイズ | カップボード キャビネット )

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。立ち下がりエッジ"fall_o"はその逆です。

使用例:エッジカウンタ

if文の中で先ほどの検出式や検出信号を使用すれば、信号の立ち上がりや立ち下がりをカウントすることができます 屋外灯 LED 【送料無料】 【setsuden_led】 自動点灯無し ポール別売 遠藤照明 畳数設定無し 【smtb-TK】 K区分 XRL5001H その他屋外灯 ペールグリーン 【ベッドタイプ】 新20色羽根布団8点セット洗い替え用布団カバー3点セット マットレス付き ファミリーベッド 送料無料 家族ベッド 【日本製ボンネルコイルマットレス付き】 連結ベッド カップル 繋げる 国産ベッドフレーム 夫婦 新婚 親子ベッド 分割 ジョイント ライト照明付き 木製ベッド 棚付き イース ワイドキングベッド ワイドK280 フレーム コンセント付き連結フロアベッド 【日本製ポケットコイルマットレス付き】 Wide】。

library ieee;
use ieee.std_logic_1164.all;
use ieee.std_logic_unsigned.all;
entity edge_count is
 port (
 srstn_i : in std_logic;
 clk_i : in std_logic;
 sig_i : in std_logic;
 rise_count_o : out std_logic_vector (15 downto 0);
 fall_count_o : out std_logic_vector (15 downto 0)
 );
end edge_count;
architecture rtl of edge_count is
signal sig_ff : std_logic;
signal sig_rise : std_logic;
signal rise_count : std_logic_vector (15 downto 0);
signal fall_count : std_logic_vector (15 downto 0);
begin
process (clk_i) begin
 if (rising_edge(clk_i)) then
 if (srstn_i = '0') then
 sig_ff <= '0';
 else
 sig_ff <= sig_i;
 end if;
 end if;
end process;
-- 立ち上がり検出を組み合わせ回路で記述
-- if文に検出信号を使用
sig_rise <= sig_i and (not sig_ff);
process (clk_i) begin
 if (rising_edge(clk_i)) then
 if (srstn_i = '0') then
 rise_count <= (others => '0');
 else
 if (sig_rise = '1') then
 rise_count <= rise_count + 1;
 end if;
 end if;
 end if;
end process;
-- if文に直接立ち上がり条件を書いてもエッジ検出可能
process (clk_i) begin
 if (rising_edge(clk_i)) then
 if (srstn_i = '0') then
 fall_count <= (others => '0');
 else
 if ((sig_i = '0') and (sig_ff = '1')) then
 fall_count <= fall_count + 1;
 end if;
 end if;
 end if;
end process;
rise_count_o <= rise_count;
fall_count_o <= fall_count;
end rtl;

下図がシミュレーション結果です。。

{yahoojp} {knowledge-output.net} xt01-zzp02-tu2-3084 2